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隶属试卷 题号 题干 难度系数/错误率
   2021年上半年
   嵌入式系统设计..
   上午试卷 综合知识
第26题
选择题
高速缓存控制器负责 CPU和高速缓存/主存之间进行通信控制,如下图所示。图中①、②、③、④、⑤对应的分别是()。


67%
   2020年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第4题
选择题
在计算机外部设备和主存之间直接传送而不是由CPU执行程序指令进行数据传送的控制方式称为(4)。

46%
   2020年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第1题
选择题
在CPU和主存之间设置高速缓存(Cache)的目的是解决(1)的问题。

45%
   2019年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第37题
选择题
某计算机主存容量为64KB,其中ROM区为4KB,其余为RAM区,按字节编址。现要用2Kx8位的ROM芯片和4Kx4位的RAM芯片来设计该存储器,则需要上述规格的ROM芯片数和RAM芯片数分别是(37)。

52%
   2018年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第34题
选择题
容量为64块的Cache采用组相联方式映像,块大小为128字节,每4块为一组,若主存容量为4096块,且以字节编址,那么主存地址为(34)位,主存区号为(35)位。

53%
   2017年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第46题
选择题
某32位计算机Cache容量16KB,Cache块大小16Byte,假设主存与Cachs地址映像采用直接映像方式,则主存地址为1234E8F8(十六进制)的单元,装入Cache的地址是(46)。

46%
   2017年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第25题
选择题
典型的嵌入式系统存储器层次结构示意图如下所示,存储层次由低到高依次是辅助存储器、主存储器、高速缓存Cache、寄存器,以下叙述中错误的是(25)。

38%
   2017年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第1题
选择题
在程序的执行过程中,Cache与主存的地址映射是由(1)完成的。

39%
   2016年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第51题
选择题
以下关于Cache和主存叙述中,不正确的是(51)。

39%
   2016年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第38题
选择题
在程序的执行过程中,Cache与主存的地址映射是由(38)。

29%
   2016年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第6题
选择题
以下关于Cache与主存间地址映射的叙述中,正确的是(6)。

46%
   2015年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第39题
选择题
某同步总线的时钟频率为100MHz,宽度为32位,地址/数据线复用,每传输一个地址或者数据占有一个时钟周期。若该总线支持burst(猝发)传输方式,则一次“主存写”总线事务传输一个数组intbuf[4]所需要的时间至少是(39)ns。

50%
   2015年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第37题
选择题
已知Cache命中率H=0.98,主存比Cache慢4倍,已知主存存取周期为200ns,则系统的平均访问时间是(37)ns。

43%
   2015年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第36题
选择题
主存储器和CPU之间增加Cache的目的是(36)。

28%
   2014年下半年
   嵌入式系统设计..
   上午试卷 综合知识
第6题
选择题
在CPU和主存之间设置“Cache”的作用是为了解决(6)的问题。

39%
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