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科目：

关键词：

主存

隶属试卷

题号

题干

难度系数/错误率

   2023年上半年
   软件设计师
   上午试卷综合知识

第2题
选择题

在由高速缓存，主存和硬盘构成的三级存储体系中,CPU执行指令时需要读取数据，那么DMA控制器和中断CPU发出的数据地址是（）。

51%

   2020年下半年
   软件设计师
   上午试卷综合知识

第1题
选择题

在程序执行过程中，高速缓存(Cache) 与主存间的地址映射由（）。

42%

   2017年下半年
   软件设计师
   上午试卷综合知识

第5题
选择题

计算机系统的主存主要是由（）构成的。

32%

   2017年下半年
   软件设计师
   上午试卷综合知识

第2题
选择题

在程序执行过程中，Cache与主存的地址映射是由（）完成的。

36%

   2016年下半年
   软件设计师
   上午试卷综合知识

第6题
选择题

以下关于Cache与主存间地址映射的叙述中，正确的是（6）。

26%

   2016年上半年
   软件设计师
   上午试卷综合知识

第2题
选择题

主存与Cache的地址映射方式中，（2）方式可以实现主存任意一块装入Cache中任意位置，只有装满才需要替换。

39%

   2013年下半年
   软件设计师
   上午试卷综合知识

第1题
选择题

在程序执行过程中，Cache与主存的地址映像由(1)。

23%

   2012年上半年
   软件设计师
   上午试卷综合知识

第1题
选择题

位于CPU与主存之间的高速缓冲存储器（Cache)用于存放部分主存数据的拷贝，主存地址与Cache地址之间的转换工作由（1）完成。

11%

   2011年下半年
   软件设计师
   上午试卷综合知识

第3题
选择题

在程序的执行过程中，Cache与主存的地址映像由(3)。

20%

   2011年下半年
   软件设计师
   上午试卷综合知识

第2题
选择题

若某计算机系统的I/O接口与主存采用统一编址，则输入输出操作是通过(2)指令来完成的。

55%

   2010年下半年
   软件设计师
   上午试卷综合知识

第1题
选择题

在输入输出控制方法中，采用（1）可以使得设备与主存间的数据块传送无需CPU干预。

27%

示例说明：

选择

案例

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